clk: qoriq: use macros to generate pll_mask
Use macros to generate pll_mask to make code more readable. Signed-off-by: Wasim Khan <wasim.khan@nxp.com> Link: https://lore.kernel.org/r/20210125142513.3919014-1-wasim.khan@oss.nxp.com Signed-off-by: Stephen Boyd <sboyd@kernel.org>
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5c8fe583cc
commit
fa4dd53eee
@ -1,6 +1,7 @@
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// SPDX-License-Identifier: GPL-2.0-only
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// SPDX-License-Identifier: GPL-2.0-only
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/*
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/*
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* Copyright 2013 Freescale Semiconductor, Inc.
|
* Copyright 2013 Freescale Semiconductor, Inc.
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|
* Copyright 2021 NXP
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*
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*
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* clock driver for Freescale QorIQ SoCs.
|
* clock driver for Freescale QorIQ SoCs.
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*/
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*/
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||||||
@ -564,7 +565,9 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
|||||||
.cmux_to_group = {
|
.cmux_to_group = {
|
||||||
0, 1, 1, 1, -1
|
0, 1, 1, 1, -1
|
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|
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|
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|
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|
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|
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|
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|
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|
.flags = CG_PLL_8BIT,
|
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|
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{
|
{
|
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@ -580,7 +583,9 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
|||||||
.cmux_to_group = {
|
.cmux_to_group = {
|
||||||
0, 1, 1, 1, -1
|
0, 1, 1, 1, -1
|
||||||
},
|
},
|
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.pll_mask = 0x3f,
|
.pll_mask = BIT(PLATFORM_PLL) |
|
||||||
|
BIT(CGA_PLL1) | BIT(CGA_PLL2) | BIT(CGA_PLL3) |
|
||||||
|
BIT(CGB_PLL1) | BIT(CGB_PLL2),
|
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.flags = CG_PLL_8BIT,
|
.flags = CG_PLL_8BIT,
|
||||||
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|
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|
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{
|
{
|
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@ -591,7 +596,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
|||||||
.cmux_to_group = {
|
.cmux_to_group = {
|
||||||
0, -1
|
0, -1
|
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},
|
},
|
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.pll_mask = 0x03,
|
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|
||||||
|
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|
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},
|
},
|
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{
|
{
|
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|
.compat = "fsl,ls1028a-clockgen",
|
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@ -605,7 +611,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
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.cmux_to_group = {
|
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|
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|
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|
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|
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|
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|
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|
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|
.flags = CG_VER3 | CG_LITTLE_ENDIAN,
|
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|
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|
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|
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@ -620,7 +627,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
{
|
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@ -635,7 +643,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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@ -649,7 +658,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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@ -660,7 +670,7 @@ static const struct clockgen_chipinfo chipinfo[] = {
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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@ -694,7 +708,8 @@ static const struct clockgen_chipinfo chipinfo[] = {
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|
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|
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|
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|
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|
.compat = "fsl,p5040-clockgen",
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|
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|
||||||
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|
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.compat = "fsl,t1023-clockgen",
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|
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|
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|
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|
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|
.pll_mask = BIT(PLATFORM_PLL) |
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|
.flags = CG_PLL_8BIT,
|
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},
|
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{},
|
{},
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